Simulator compatibility updates
This commit is contained in:
@@ -69,7 +69,7 @@
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assert(cb.hwif_out.reg1_msb0.f1.value == 0);
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cpuif.write('hE, 'hDEF1);
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@cb; @cb;
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assert({<<{cb.hwif_out.reg1_msb0.f1.value}} == 64'hDEF19ABC56781234);
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assert(`bitswap(cb.hwif_out.reg1_msb0.f1.value) == 64'hDEF19ABC56781234);
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cpuif.assert_read('h8, 'h1234);
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cpuif.assert_read('hA, 'h5678);
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cpuif.assert_read('hC, 'h9ABC);
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@@ -104,8 +104,8 @@
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assert(cb.hwif_out.reg2_msb0.f2.value == 0);
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cpuif.write('h16, 'hAA12);
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@cb; @cb;
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assert({<<{cb.hwif_out.reg2_msb0.f1.value}} == 12'h234);
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assert({<<{cb.hwif_out.reg2_msb0.f2.value}} == 4'h1);
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assert(`bitswap(cb.hwif_out.reg2_msb0.f1.value) == 12'h234);
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assert(`bitswap(cb.hwif_out.reg2_msb0.f2.value) == 4'h1);
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cpuif.assert_read('h14, 'h3400);
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cpuif.assert_read('h16, 'h0012);
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@@ -281,7 +281,7 @@
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cpuif.assert_read('hA, 'h0200);
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cpuif.assert_read('hC, 'h0070);
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cpuif.assert_read('hE, 'h0002);
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assert({<<{cb.hwif_out.reg1_msb0.f1.value}} == 'h0002_0070_0200_A000);
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assert(`bitswap(cb.hwif_out.reg1_msb0.f1.value) == 'h0002_0070_0200_A000);
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// Check that strobes are cumulative
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cpuif.write('h8, 'h0030, 'h00F0);
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@@ -297,7 +297,7 @@
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cpuif.assert_read('hA, 'h0278);
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cpuif.assert_read('hC, 'hA07D);
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cpuif.assert_read('hE, 'hAF02);
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assert({<<{cb.hwif_out.reg1_msb0.f1.value}} == 'hAF02_A07D_0278_A230);
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assert(`bitswap(cb.hwif_out.reg1_msb0.f1.value) == 'hAF02_A07D_0278_A230);
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{% endblock %}
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@@ -2,6 +2,8 @@ from ..lib.sim_testcase import SimTestCase
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from ..lib.cpuifs.passthrough import Passthrough
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class Test(SimTestCase):
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incompatible_sim_tools = {"xsim"} # due to cb struct assignment bug
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cpuif = Passthrough() # test with bit strobes
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def test_dut(self):
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Reference in New Issue
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