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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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{
|
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|
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|
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|
|
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|
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{
|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
|
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|
|
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|
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|
|
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|
|
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|
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|
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|
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|
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|
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|
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|
|
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|
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|
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|
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|
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|
|
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|
|
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|
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|
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|
|
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|
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|
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|
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|
|
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|
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|
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|
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|
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|
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|
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|
|
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|
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|
|
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|
|
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|
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|
|
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|
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|
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|
|
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|
|
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|
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|
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|
|
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|
|
]
|
|
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|
|
{
|
|
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|
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|
|
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|
|
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|
|
]
|
|
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|
|
{
|
|
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|
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|
|
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|
|
]
|
|
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|
|
{
|
|
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|
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"u_sdram_adapter"
|
|
]
|
|
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|
|
{
|
|
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|
|
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|
|
]
|
|
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|
|
{
|
|
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|
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"u_sdram_adapter"
|
|
]
|
|
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|
|
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|
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|
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|
|
"u_sdram_adapter"
|
|
]
|
|
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|
|
{
|
|
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|
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|
|
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|
|
"u_sdram_adapter"
|
|
]
|
|
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|
|
{
|
|
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|
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|
|
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|
|
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|
|
]
|
|
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|
|
{
|
|
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|
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|
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|
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|
|
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|
|
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|
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|
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|
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|
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|
|
]
|
|
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|
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|
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|
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|
|
]
|
|
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|
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{
|
|
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|
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|
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|
|
]
|
|
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|
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{
|
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|
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|
|
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|
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|
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|
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|
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|
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|
|
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|
|
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|
|
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"u_sdram_adapter"
|
|
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"u_sdram_adapter"
|
|
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|
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|
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|
|
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|
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|
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|
|
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|
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|
|
]
|
|
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|
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|
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|
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|
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|
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|
|
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|
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|
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|
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|
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|
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|
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|
|
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|
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|
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|
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|
|
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|
|
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|
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|
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|
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|
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|
|
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|
|
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|
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|
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|
|
]
|
|
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|
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{
|
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|
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|
|
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|
|
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|
|
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|
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|
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|
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|
|
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|
|
"u_sdram_adapter"
|
|
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|
|
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|
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|
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|
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|
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|
|
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|
|
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|
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|
|
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|
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|
|
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|
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|
|
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|
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|
|
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|
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|
|
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|
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|
|
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|
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|
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|
|
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|
|
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|
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|
|
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|
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|
|
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|
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|
|
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|
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|
|
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|
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|
|
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|
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|
|
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|
|
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|
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|
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|
|
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|
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|
|
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|
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|
|
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|
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|
|
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|
|
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|
|
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|
|
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|
|
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|
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|
|
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|
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|
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|
|
]
|
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{
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|
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|
|
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|
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|
|
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|
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|
|
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|
|
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|
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|
|
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|
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|
|
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|
|
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|
|
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|
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|
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|
|
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|
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|
|
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|
|
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|
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|
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|
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|
|
"u_sdram_adapter"
|
|
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|
|
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{
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|
|
"u_sdram_adapter"
|
|
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|
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|
|
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|
|
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|
|
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|
|
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|
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|
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|
|
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|
|
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|
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|
|
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|
|
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|
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|
|
"u_sdram_adapter"
|
|
]
|
|
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|
|
{
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|
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|
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|
|
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|
|
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|
|
]
|
|
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|
|
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|
|
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|
|
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{
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|
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|
|
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|
|
"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
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|
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{
|
|
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|
|
"net": "o_data[2]",
|
|
"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
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|
|
{
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|
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|
|
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|
|
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|
|
"u_sdram_adapter"
|
|
]
|
|
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|
|
{
|
|
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|
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|
|
"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
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|
|
{
|
|
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|
|
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|
|
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|
|
"u_sdram_adapter"
|
|
]
|
|
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|
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{
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|
|
"net": "o_data[6]",
|
|
"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
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|
|
{
|
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|
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"net": "o_data[7]",
|
|
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|
|
"u_sdram_adapter"
|
|
]
|
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{
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|
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|
|
"u_sdram_adapter"
|
|
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|
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{
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|
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|
|
"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
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|
|
{
|
|
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|
|
"net": "o_sdr_state[2]",
|
|
"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
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|
|
{
|
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|
|
"net": "o_sdr_state[3]",
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|
|
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|
|
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|
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|
|
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|
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|
|
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|
|
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|
|
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|
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{
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|
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|
|
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|
|
"u_sdram_adapter"
|
|
]
|
|
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|
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{
|
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|
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|
|
"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
},
|
|
{
|
|
"name": "la0_probe17[4]",
|
|
"net": "r_addr[4]",
|
|
"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
},
|
|
{
|
|
"name": "la0_probe17[5]",
|
|
"net": "r_addr[5]",
|
|
"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
},
|
|
{
|
|
"name": "la0_probe17[6]",
|
|
"net": "r_addr[6]",
|
|
"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
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|
|
{
|
|
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|
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|
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|
|
"u_sdram_adapter"
|
|
]
|
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{
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|
|
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|
|
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|
|
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|
|
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|
|
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|
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|
|
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|
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{
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|
|
"u_sdram_adapter"
|
|
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|
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{
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|
|
"u_sdram_adapter"
|
|
]
|
|
},
|
|
{
|
|
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"net": "r_addr[17]",
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"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
},
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|
{
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|
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"u_sdram_adapter"
|
|
]
|
|
},
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|
{
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|
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"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
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|
|
{
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"net": "r_addr[20]",
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|
"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
},
|
|
{
|
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"name": "la0_probe17[21]",
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"net": "r_addr[21]",
|
|
"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
},
|
|
{
|
|
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|
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|
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|
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|
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|
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|
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|
|
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|
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|
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|
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|
|
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|
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|
|
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|
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|
|
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|
|
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|
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|
|
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|
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|
|
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|
|
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|
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|
|
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|
|
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|
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|
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|
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|
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|
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|
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|
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|
|
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|
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|
|
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|
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|
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|
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|
|
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|
|
]
|
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|
|
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|
|
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|
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|
|
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|
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|
|
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|
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|
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"u_sdram_adapter"
|
|
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|
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{
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"u_sdram_adapter"
|
|
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{
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|
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"u_sdram_adapter"
|
|
]
|
|
},
|
|
{
|
|
"name": "la0_probe22[17]",
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"net": "w_data_i[17]",
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"path": [
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"u_sdram_adapter"
|
|
]
|
|
},
|
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{
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"u_sdram_adapter"
|
|
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{
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{
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"u_sdram_adapter"
|
|
]
|
|
},
|
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{
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|
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|
|
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|
|
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|
|
]
|
|
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|
|
{
|
|
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|
|
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|
|
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|
|
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|
|
]
|
|
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|
|
{
|
|
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|
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|
|
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|
|
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|
|
]
|
|
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|
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{
|
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|
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|
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|
|
"u_sdram_adapter"
|
|
]
|
|
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|
|
{
|
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|
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|
|
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|
|
]
|
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|
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|
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|
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|
|
]
|
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|
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|
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|
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|
|
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|
|
]
|
|
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|
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|
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|
|
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|
|
]
|
|
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|
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|
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|
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|
|
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|
|
]
|
|
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|
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|
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|
|
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|
|
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|
|
]
|
|
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|
|
{
|
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|
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|
|
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|
|
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|
|
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|
|
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|
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|
|
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|
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|
|
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|
|
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|
|
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|
|
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|
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|
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|
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|
|
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|
|
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|
|
]
|
|
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|
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|
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|
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|
|
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|
|
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|
|
]
|
|
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|
|
{
|
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|
|
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|
|
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|
|
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|
|
]
|
|
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|
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|
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|
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|
|
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|
|
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|
|
]
|
|
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|
|
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|
|
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|
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|
|
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|
|
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|
|
]
|
|
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|
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|
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|
|
"u_sdram_adapter"
|
|
]
|
|
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|
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|
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|
|
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|
|
]
|
|
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|
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{
|
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|
|
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|
|
]
|
|
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|
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{
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|
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|
|
"u_sdram_adapter"
|
|
]
|
|
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|
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|
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|
|
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|
|
"u_sdram_adapter"
|
|
]
|
|
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|
|
{
|
|
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|
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|
|
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|
|
"u_sdram_adapter"
|
|
]
|
|
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|
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{
|
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|
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|
|
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|
|
"u_sdram_adapter"
|
|
]
|
|
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|
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{
|
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|
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|
|
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|
|
"u_sdram_adapter"
|
|
]
|
|
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|
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{
|
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|
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|
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|
|
"u_sdram_adapter"
|
|
]
|
|
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|
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{
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|
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|
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|
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|
|
"u_sdram_adapter"
|
|
]
|
|
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|
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{
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|
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|
|
"u_sdram_adapter"
|
|
]
|
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|
|
"u_sdram_adapter"
|
|
]
|
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|
|
"u_sdram_adapter"
|
|
]
|
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|
|
"u_sdram_adapter"
|
|
]
|
|
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{
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|
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|
|
"u_sdram_adapter"
|
|
]
|
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|
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{
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|
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|
|
"u_sdram_adapter"
|
|
]
|
|
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{
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|
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|
|
"u_sdram_adapter"
|
|
]
|
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{
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|
|
"u_sdram_adapter"
|
|
]
|
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{
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|
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|
|
"u_sdram_adapter"
|
|
]
|
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{
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|
|
"u_sdram_adapter"
|
|
]
|
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{
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|
|
"u_sdram_adapter"
|
|
]
|
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{
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|
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|
|
"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
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|
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{
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|
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|
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"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
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|
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{
|
|
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|
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|
|
"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
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|
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{
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|
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|
|
"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
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|
|
{
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|
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|
|
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|
|
"u_sdram_adapter"
|
|
]
|
|
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|
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{
|
|
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|
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|
|
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|
|
"u_sdram_adapter"
|
|
]
|
|
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|
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{
|
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|
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|
|
"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
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|
|
{
|
|
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|
|
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|
|
"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
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|
|
{
|
|
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|
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|
|
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|
|
"u_sdram_adapter"
|
|
]
|
|
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|
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{
|
|
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|
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|
|
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|
|
"u_sdram_adapter"
|
|
]
|
|
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|
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{
|
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|
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|
|
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|
|
"u_sdram_adapter"
|
|
]
|
|
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|
|
{
|
|
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|
|
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|
|
"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
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|
|
{
|
|
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|
|
"net": "w_rd_valid",
|
|
"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
},
|
|
{
|
|
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|
|
"net": "w_read",
|
|
"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
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|
|
{
|
|
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|
|
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|
|
"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
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|
|
{
|
|
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|
|
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|
|
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|
|
"u_sdram_adapter"
|
|
]
|
|
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|
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{
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|
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|
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|
|
"u_sdram_adapter"
|
|
]
|
|
},
|
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{
|
|
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|
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|
|
"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
},
|
|
{
|
|
"name": "la0_probe32[2]",
|
|
"net": "_data[2]",
|
|
"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
},
|
|
{
|
|
"name": "la0_probe32[3]",
|
|
"net": "_data[3]",
|
|
"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
},
|
|
{
|
|
"name": "la0_probe32[4]",
|
|
"net": "_data[4]",
|
|
"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
},
|
|
{
|
|
"name": "la0_probe32[5]",
|
|
"net": "_data[5]",
|
|
"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
},
|
|
{
|
|
"name": "la0_probe32[6]",
|
|
"net": "_data[6]",
|
|
"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
},
|
|
{
|
|
"name": "la0_probe32[7]",
|
|
"net": "_data[7]",
|
|
"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
}
|
|
]
|
|
}
|
|
}
|
|
],
|
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"vdbs": [
|
|
{
|
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|
|
"instance": "edb_top_inst"
|
|
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|
|
],
|
|
"session": {
|
|
"wizard": {
|
|
"data_depth": 2048,
|
|
"capture_control": false,
|
|
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|
|
{
|
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"name": "cpu_addr",
|
|
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|
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|
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|
|
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|
|
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|
|
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|
|
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|
|
},
|
|
{
|
|
"name": "cpu_data_in",
|
|
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|
|
"clk_domain": "i_sysclk",
|
|
"selected_probe_type": "DATA AND TRIGGER",
|
|
"child": [],
|
|
"path": [],
|
|
"net_idx_left": 7,
|
|
"net_idx_right": 0
|
|
},
|
|
{
|
|
"name": "cpu_rwb",
|
|
"width": 1,
|
|
"clk_domain": "i_sysclk",
|
|
"selected_probe_type": "DATA AND TRIGGER",
|
|
"child": [],
|
|
"path": []
|
|
},
|
|
{
|
|
"name": "cpu_sync",
|
|
"width": 1,
|
|
"clk_domain": "i_sysclk",
|
|
"selected_probe_type": "DATA AND TRIGGER",
|
|
"child": [],
|
|
"path": []
|
|
},
|
|
{
|
|
"name": "addr_mux_out",
|
|
"width": 24,
|
|
"clk_domain": "i_sysclk",
|
|
"selected_probe_type": "DATA AND TRIGGER",
|
|
"child": [],
|
|
"path": [
|
|
"u_sdram_adapter"
|
|
],
|
|
"net_idx_left": 23,
|
|
"net_idx_right": 0
|
|
},
|
|
{
|
|
"name": "counter",
|
|
"width": 2,
|
|
"clk_domain": "i_sysclk",
|
|
"selected_probe_type": "DATA AND TRIGGER",
|
|
"child": [],
|
|
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|
|
"u_sdram_adapter"
|
|
],
|
|
"net_idx_left": 1,
|
|
"net_idx_right": 0
|
|
},
|
|
{
|
|
"name": "data",
|
|
"width": 8,
|
|
"clk_domain": "i_sysclk",
|
|
"selected_probe_type": "DATA AND TRIGGER",
|
|
"child": [],
|
|
"path": [
|
|
"u_sdram_adapter"
|
|
],
|
|
"net_idx_left": 7,
|
|
"net_idx_right": 0
|
|
},
|
|
{
|
|
"name": "i_addr",
|
|
"width": 25,
|
|
"clk_domain": "i_sysclk",
|
|
"selected_probe_type": "DATA AND TRIGGER",
|
|
"child": [],
|
|
"path": [
|
|
"u_sdram_adapter"
|
|
],
|
|
"net_idx_left": 24,
|
|
"net_idx_right": 0
|
|
},
|
|
{
|
|
"name": "i_arst",
|
|
"width": 1,
|
|
"clk_domain": "i_sysclk",
|
|
"selected_probe_type": "DATA AND TRIGGER",
|
|
"child": [],
|
|
"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
},
|
|
{
|
|
"name": "i_cpuclk",
|
|
"width": 1,
|
|
"clk_domain": "i_sysclk",
|
|
"selected_probe_type": "DATA AND TRIGGER",
|
|
"child": [],
|
|
"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
},
|
|
{
|
|
"name": "i_cs",
|
|
"width": 1,
|
|
"clk_domain": "i_sysclk",
|
|
"selected_probe_type": "DATA AND TRIGGER",
|
|
"child": [],
|
|
"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
},
|
|
{
|
|
"name": "i_data",
|
|
"width": 8,
|
|
"clk_domain": "i_sysclk",
|
|
"selected_probe_type": "DATA AND TRIGGER",
|
|
"child": [],
|
|
"path": [
|
|
"u_sdram_adapter"
|
|
],
|
|
"net_idx_left": 7,
|
|
"net_idx_right": 0
|
|
},
|
|
{
|
|
"name": "i_rwb",
|
|
"width": 1,
|
|
"clk_domain": "i_sysclk",
|
|
"selected_probe_type": "DATA AND TRIGGER",
|
|
"child": [],
|
|
"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
},
|
|
{
|
|
"name": "next_counter",
|
|
"width": 2,
|
|
"clk_domain": "i_sysclk",
|
|
"selected_probe_type": "DATA AND TRIGGER",
|
|
"child": [],
|
|
"path": [
|
|
"u_sdram_adapter"
|
|
],
|
|
"net_idx_left": 1,
|
|
"net_idx_right": 0
|
|
},
|
|
{
|
|
"name": "next_state",
|
|
"width": 2,
|
|
"clk_domain": "i_sysclk",
|
|
"selected_probe_type": "DATA AND TRIGGER",
|
|
"child": [],
|
|
"path": [
|
|
"u_sdram_adapter"
|
|
],
|
|
"net_idx_left": 1,
|
|
"net_idx_right": 0
|
|
},
|
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{
|
|
"name": "o_data",
|
|
"width": 8,
|
|
"clk_domain": "i_sysclk",
|
|
"selected_probe_type": "DATA AND TRIGGER",
|
|
"child": [],
|
|
"path": [
|
|
"u_sdram_adapter"
|
|
],
|
|
"net_idx_left": 7,
|
|
"net_idx_right": 0
|
|
},
|
|
{
|
|
"name": "o_sdr_state",
|
|
"width": 4,
|
|
"clk_domain": "i_sysclk",
|
|
"selected_probe_type": "DATA AND TRIGGER",
|
|
"child": [],
|
|
"path": [
|
|
"u_sdram_adapter"
|
|
],
|
|
"net_idx_left": 3,
|
|
"net_idx_right": 0
|
|
},
|
|
{
|
|
"name": "r_addr",
|
|
"width": 24,
|
|
"clk_domain": "i_sysclk",
|
|
"selected_probe_type": "DATA AND TRIGGER",
|
|
"child": [],
|
|
"path": [
|
|
"u_sdram_adapter"
|
|
],
|
|
"net_idx_left": 23,
|
|
"net_idx_right": 0
|
|
},
|
|
{
|
|
"name": "r_dm",
|
|
"width": 4,
|
|
"clk_domain": "i_sysclk",
|
|
"selected_probe_type": "DATA AND TRIGGER",
|
|
"child": [],
|
|
"path": [
|
|
"u_sdram_adapter"
|
|
],
|
|
"net_idx_left": 3,
|
|
"net_idx_right": 0
|
|
},
|
|
{
|
|
"name": "r_write_data",
|
|
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|
|
"clk_domain": "i_sysclk",
|
|
"selected_probe_type": "DATA AND TRIGGER",
|
|
"child": [],
|
|
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|
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"u_sdram_adapter"
|
|
],
|
|
"net_idx_left": 31,
|
|
"net_idx_right": 0
|
|
},
|
|
{
|
|
"name": "state",
|
|
"width": 2,
|
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"clk_domain": "i_sysclk",
|
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"selected_probe_type": "DATA AND TRIGGER",
|
|
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|
|
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|
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"u_sdram_adapter"
|
|
],
|
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"net_idx_left": 1,
|
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"net_idx_right": 0
|
|
},
|
|
{
|
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"name": "w_addr",
|
|
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|
|
"clk_domain": "i_sysclk",
|
|
"selected_probe_type": "DATA AND TRIGGER",
|
|
"child": [],
|
|
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|
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"u_sdram_adapter"
|
|
],
|
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"net_idx_left": 23,
|
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"net_idx_right": 0
|
|
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|
|
{
|
|
"name": "w_data_i",
|
|
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|
|
"clk_domain": "i_sysclk",
|
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"selected_probe_type": "DATA AND TRIGGER",
|
|
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|
|
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|
|
"u_sdram_adapter"
|
|
],
|
|
"net_idx_left": 31,
|
|
"net_idx_right": 0
|
|
},
|
|
{
|
|
"name": "w_data_o",
|
|
"width": 32,
|
|
"clk_domain": "i_sysclk",
|
|
"selected_probe_type": "DATA AND TRIGGER",
|
|
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|
|
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|
|
"u_sdram_adapter"
|
|
],
|
|
"net_idx_left": 31,
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|
|
},
|
|
{
|
|
"name": "w_data_valid",
|
|
"width": 1,
|
|
"clk_domain": "i_sysclk",
|
|
"selected_probe_type": "DATA AND TRIGGER",
|
|
"child": [],
|
|
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|
|
"u_sdram_adapter"
|
|
]
|
|
},
|
|
{
|
|
"name": "w_dm",
|
|
"width": 4,
|
|
"clk_domain": "i_sysclk",
|
|
"selected_probe_type": "DATA AND TRIGGER",
|
|
"child": [],
|
|
"path": [
|
|
"u_sdram_adapter"
|
|
],
|
|
"net_idx_left": 3,
|
|
"net_idx_right": 0
|
|
},
|
|
{
|
|
"name": "w_last",
|
|
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|
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"clk_domain": "i_sysclk",
|
|
"selected_probe_type": "DATA AND TRIGGER",
|
|
"child": [],
|
|
"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
},
|
|
{
|
|
"name": "w_rd_ack",
|
|
"width": 1,
|
|
"clk_domain": "i_sysclk",
|
|
"selected_probe_type": "DATA AND TRIGGER",
|
|
"child": [],
|
|
"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
},
|
|
{
|
|
"name": "w_rd_valid",
|
|
"width": 1,
|
|
"clk_domain": "i_sysclk",
|
|
"selected_probe_type": "DATA AND TRIGGER",
|
|
"child": [],
|
|
"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
},
|
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{
|
|
"name": "w_read",
|
|
"width": 1,
|
|
"clk_domain": "i_sysclk",
|
|
"selected_probe_type": "DATA AND TRIGGER",
|
|
"child": [],
|
|
"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
},
|
|
{
|
|
"name": "w_write",
|
|
"width": 1,
|
|
"clk_domain": "i_sysclk",
|
|
"selected_probe_type": "DATA AND TRIGGER",
|
|
"child": [],
|
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"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
},
|
|
{
|
|
"name": "w_wr_ack",
|
|
"width": 1,
|
|
"clk_domain": "i_sysclk",
|
|
"selected_probe_type": "DATA AND TRIGGER",
|
|
"child": [],
|
|
"path": [
|
|
"u_sdram_adapter"
|
|
]
|
|
},
|
|
{
|
|
"name": "_data",
|
|
"width": 8,
|
|
"clk_domain": "i_sysclk",
|
|
"selected_probe_type": "DATA AND TRIGGER",
|
|
"child": [],
|
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"path": [
|
|
"u_sdram_adapter"
|
|
],
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