bslathi19/taxi
1
0
Fork 0
mirror of https://github.com/fpganinja/taxi.git synced 2026-04-07 04:38:42 -07:00
Code Issues Packages Projects Releases Wiki Activity

cndm: Parameter cleanup

Browse Source 
Signed-off-by: Alex Forencich <alex@alexforencich.com>
This commit is contained in:
Alex Forencich
2026-03-08 17:39:28 -07:00
parent 2bb2710bbd
commit 9af793edc6
11 changed files with 91 additions and 28 deletions
Download Patch File Download Diff File Expand all files Collapse all files

12
src/cndm/rtl/cndm_lite_core.sv
View File

@@ -35,6 +35,8 @@ module cndm_lite_core #(
// Structural configuration
parameter PORTS = 2,
parameter SYS_CLK_PER_NS_NUM = 4,
parameter SYS_CLK_PER_NS_DEN = 1,
// Queue configuration
parameter WQN_W = 5,
@@ -44,7 +46,7 @@ module cndm_lite_core #(
parameter logic PTP_TS_EN = 1'b1,
parameter logic PTP_TS_FMT_TOD = 1'b0,
parameter PTP_CLK_PER_NS_NUM = 512,
parameter PTP_CLK_PER_NS_DENOM = 165
parameter PTP_CLK_PER_NS_DEN = 165
)
(
input wire logic clk,
@@ -324,8 +326,8 @@ cndm_micro_dp_mgr #(
// Structural configuration
.PORTS(PORTS),
.SYS_CLK_PER_NS_NUM(4),
.SYS_CLK_PER_NS_DENOM(1),
.SYS_CLK_PER_NS_NUM(SYS_CLK_PER_NS_NUM),
.SYS_CLK_PER_NS_DEN(SYS_CLK_PER_NS_DEN),
// Queue configuration
.WQN_W(WQN_W),
@@ -334,7 +336,7 @@ cndm_micro_dp_mgr #(
// PTP configuration
.PTP_EN(PTP_TS_EN),
.PTP_CLK_PER_NS_NUM(PTP_CLK_PER_NS_NUM),
.PTP_CLK_PER_NS_DENOM(PTP_CLK_PER_NS_DENOM),
.PTP_CLK_PER_NS_DEN(PTP_CLK_PER_NS_DEN),
// Addressing
.PTP_BASE_ADDR_DP(0),
@@ -390,7 +392,7 @@ if (PTP_TS_EN) begin : ptp
taxi_ptp_td_phc_apb #(
.PTP_CLK_PER_NS_NUM(PTP_CLK_PER_NS_NUM),
.PTP_CLK_PER_NS_DENOM(PTP_CLK_PER_NS_DENOM)
.PTP_CLK_PER_NS_DENOM(PTP_CLK_PER_NS_DEN)
)
ptp_inst (
.clk(clk),

11
src/cndm/rtl/cndm_lite_pcie_us.sv
View File

@@ -35,15 +35,18 @@ module cndm_lite_pcie_us #(
// Structural configuration
parameter PORTS = 2,
parameter SYS_CLK_PER_NS_NUM = 4,
parameter SYS_CLK_PER_NS_DEN = 1,
// Queue configuration
parameter CQN_W = 5,
parameter WQN_W = 5,
parameter CQN_W = WQN_W,
// PTP configuration
parameter logic PTP_TS_EN = 1'b1,
parameter logic PTP_TS_FMT_TOD = 1'b0,
parameter PTP_CLK_PER_NS_NUM = 512,
parameter PTP_CLK_PER_NS_DENOM = 165,
parameter PTP_CLK_PER_NS_DEN = 165,
// PCIe interface configuration
parameter RQ_SEQ_NUM_W = 6,
@@ -512,6 +515,8 @@ cndm_lite_core #(
// Structural configuration
.PORTS(PORTS),
.SYS_CLK_PER_NS_NUM(SYS_CLK_PER_NS_NUM),
.SYS_CLK_PER_NS_DEN(SYS_CLK_PER_NS_DEN),
// Queue configuration
.CQN_W(CQN_W),
@@ -520,7 +525,7 @@ cndm_lite_core #(
.PTP_TS_EN(PTP_TS_EN),
.PTP_TS_FMT_TOD(PTP_TS_FMT_TOD),
.PTP_CLK_PER_NS_NUM(PTP_CLK_PER_NS_NUM),
.PTP_CLK_PER_NS_DENOM(PTP_CLK_PER_NS_DENOM)
.PTP_CLK_PER_NS_DEN(PTP_CLK_PER_NS_DEN)
)
core_inst (
.clk(pcie_clk),

12
src/cndm/rtl/cndm_micro_core.sv
View File

@@ -35,6 +35,8 @@ module cndm_micro_core #(
// Structural configuration
parameter PORTS = 2,
parameter SYS_CLK_PER_NS_NUM = 4,
parameter SYS_CLK_PER_NS_DEN = 1,
// Queue configuration
parameter WQN_W = 5,
@@ -44,7 +46,7 @@ module cndm_micro_core #(
parameter logic PTP_TS_EN = 1'b1,
parameter logic PTP_TS_FMT_TOD = 1'b0,
parameter PTP_CLK_PER_NS_NUM = 512,
parameter PTP_CLK_PER_NS_DENOM = 165
parameter PTP_CLK_PER_NS_DEN = 165
)
(
input wire logic clk,
@@ -324,8 +326,8 @@ cndm_micro_dp_mgr #(
// Structural configuration
.PORTS(PORTS),
.SYS_CLK_PER_NS_NUM(4),
.SYS_CLK_PER_NS_DENOM(1),
.SYS_CLK_PER_NS_NUM(SYS_CLK_PER_NS_NUM),
.SYS_CLK_PER_NS_DEN(SYS_CLK_PER_NS_DEN),
// Queue configuration
.WQN_W(WQN_W),
@@ -334,7 +336,7 @@ cndm_micro_dp_mgr #(
// PTP configuration
.PTP_EN(PTP_TS_EN),
.PTP_CLK_PER_NS_NUM(PTP_CLK_PER_NS_NUM),
.PTP_CLK_PER_NS_DENOM(PTP_CLK_PER_NS_DENOM),
.PTP_CLK_PER_NS_DEN(PTP_CLK_PER_NS_DEN),
// Addressing
.PTP_BASE_ADDR_DP(0),
@@ -390,7 +392,7 @@ if (PTP_TS_EN) begin : ptp
taxi_ptp_td_phc_apb #(
.PTP_CLK_PER_NS_NUM(PTP_CLK_PER_NS_NUM),
.PTP_CLK_PER_NS_DENOM(PTP_CLK_PER_NS_DENOM)
.PTP_CLK_PER_NS_DENOM(PTP_CLK_PER_NS_DEN)
)
ptp_inst (
.clk(clk),

8
src/cndm/rtl/cndm_micro_dp_mgr.sv
View File

@@ -30,7 +30,7 @@ module cndm_micro_dp_mgr #
// Structural configuration
parameter PORTS = 2,
parameter SYS_CLK_PER_NS_NUM = 4,
parameter SYS_CLK_PER_NS_DENOM = 1,
parameter SYS_CLK_PER_NS_DEN = 1,
// Queue configuration
parameter WQN_W = 5,
@@ -39,7 +39,7 @@ module cndm_micro_dp_mgr #
// PTP configuration
parameter logic PTP_EN = 1'b1,
parameter PTP_CLK_PER_NS_NUM = 512,
parameter PTP_CLK_PER_NS_DENOM = 165,
parameter PTP_CLK_PER_NS_DEN = 165,
// Addressing
parameter PTP_BASE_ADDR_DP = 0,
@@ -203,11 +203,11 @@ logic [31:0] id_rom[(ID_PAGES+1)*8] = '{
0, // 19
{ // 20
16'(SYS_CLK_PER_NS_NUM), // [31:16]
16'(SYS_CLK_PER_NS_DENOM) // [15:0]
16'(SYS_CLK_PER_NS_DEN) // [15:0]
},
{ // 21
16'(PTP_CLK_PER_NS_NUM), // [31:16]
16'(PTP_CLK_PER_NS_DENOM) // [15:0]
16'(PTP_CLK_PER_NS_DEN) // [15:0]
},
0, // 22
0, // 23

12
src/cndm/rtl/cndm_micro_pcie_us.sv
View File

@@ -35,15 +35,18 @@ module cndm_micro_pcie_us #(
// Structural configuration
parameter PORTS = 2,
parameter SYS_CLK_PER_NS_NUM = 4,
parameter SYS_CLK_PER_NS_DEN = 1,
// Queue configuration
parameter CQN_W = 5,
parameter WQN_W = 5,
parameter CQN_W = WQN_W,
// PTP configuration
parameter logic PTP_TS_EN = 1'b1,
parameter logic PTP_TS_FMT_TOD = 1'b0,
parameter PTP_CLK_PER_NS_NUM = 512,
parameter PTP_CLK_PER_NS_DENOM = 165,
parameter PTP_CLK_PER_NS_DEN = 165,
// PCIe interface configuration
parameter RQ_SEQ_NUM_W = 6,
@@ -512,15 +515,18 @@ cndm_micro_core #(
// Structural configuration
.PORTS(PORTS),
.SYS_CLK_PER_NS_NUM(SYS_CLK_PER_NS_NUM),
.SYS_CLK_PER_NS_DEN(SYS_CLK_PER_NS_DEN),
// Queue configuration
.WQN_W(WQN_W),
.CQN_W(CQN_W),
// PTP configuration
.PTP_TS_EN(PTP_TS_EN),
.PTP_TS_FMT_TOD(PTP_TS_FMT_TOD),
.PTP_CLK_PER_NS_NUM(PTP_CLK_PER_NS_NUM),
.PTP_CLK_PER_NS_DENOM(PTP_CLK_PER_NS_DENOM)
.PTP_CLK_PER_NS_DEN(PTP_CLK_PER_NS_DEN)
)
core_inst (
.clk(pcie_clk),

8
src/cndm/tb/cndm_lite_pcie_us/Makefile
View File

@@ -38,12 +38,18 @@ export PARAM_FAMILY := "\"virtexuplus\""
# Structural configuration
export PARAM_PORTS := 2
export PARAM_SYS_CLK_PER_NS_NUM := 4
export PARAM_SYS_CLK_PER_NS_DEN := 1
# Queue configuration
export PARAM_WQN_W := 5
export PARAM_CQN_W := $(PARAM_WQN_W)
# PTP configuration
export PARAM_PTP_TS_EN := 1
export PARAM_PTP_TS_FMT_TOD := 0
export PARAM_PTP_CLK_PER_NS_NUM := 512
export PARAM_PTP_CLK_PER_NS_DENOM := 165
export PARAM_PTP_CLK_PER_NS_DEN := 165
# PCIe interface configuration
export PARAM_AXIS_PCIE_DATA_W := 512

8
src/cndm/tb/cndm_lite_pcie_us/test_cndm_lite_pcie_us.py
View File

@@ -482,12 +482,18 @@ def test_cndm_lite_pcie_us(request, pcie_data_w, mac_data_w):
# Structural configuration
parameters['PORTS'] = 2
parameters['SYS_CLK_PER_NS_NUM'] = 4
parameters['SYS_CLK_PER_NS_DEN'] = 1
# Queue configuration
parameters['WQN_W'] = 5
parameters['CQN_W'] = parameters['WQN_W']
# PTP configuration
parameters['PTP_TS_EN'] = 1
parameters['PTP_TS_FMT_TOD'] = 0
parameters['PTP_CLK_PER_NS_NUM'] = 512
parameters['PTP_CLK_PER_NS_DENOM'] = 165
parameters['PTP_CLK_PER_NS_DEN'] = 165
# PCIe interface configuration
parameters['AXIS_PCIE_DATA_W'] = pcie_data_w

16
src/cndm/tb/cndm_lite_pcie_us/test_cndm_lite_pcie_us.sv
View File

@@ -34,12 +34,18 @@ module test_cndm_lite_pcie_us #
// Structural configuration
parameter PORTS = 2,
parameter SYS_CLK_PER_NS_NUM = 4,
parameter SYS_CLK_PER_NS_DEN = 1,
// Queue configuration
parameter WQN_W = 5,
parameter CQN_W = WQN_W,
// PTP configuration
parameter logic PTP_TS_EN = 1'b1,
parameter logic PTP_TS_FMT_TOD = 1'b0,
parameter PTP_CLK_PER_NS_NUM = 512,
parameter PTP_CLK_PER_NS_DENOM = 165,
parameter PTP_CLK_PER_NS_DEN = 165,
// PCIe interface configuration
parameter AXIS_PCIE_DATA_W = 512,
@@ -206,12 +212,18 @@ cndm_lite_pcie_us #(
// Structural configuration
.PORTS(PORTS),
.SYS_CLK_PER_NS_NUM(SYS_CLK_PER_NS_NUM),
.SYS_CLK_PER_NS_DEN(SYS_CLK_PER_NS_DEN),
// Queue configuration
.WQN_W(WQN_W),
.CQN_W(CQN_W),
// PTP configuration
.PTP_TS_EN(PTP_TS_EN),
.PTP_TS_FMT_TOD(PTP_TS_FMT_TOD),
.PTP_CLK_PER_NS_NUM(PTP_CLK_PER_NS_NUM),
.PTP_CLK_PER_NS_DENOM(PTP_CLK_PER_NS_DENOM),
.PTP_CLK_PER_NS_DEN(PTP_CLK_PER_NS_DEN),
// PCIe interface configuration
.RQ_SEQ_NUM_W(RQ_SEQ_NUM_W),

8
src/cndm/tb/cndm_micro_pcie_us/Makefile
View File

@@ -38,12 +38,18 @@ export PARAM_FAMILY := "\"virtexuplus\""
# Structural configuration
export PARAM_PORTS := 2
export PARAM_SYS_CLK_PER_NS_NUM := 4
export PARAM_SYS_CLK_PER_NS_DEN := 1
# Queue configuration
export PARAM_WQN_W := 5
export PARAM_CQN_W := $(PARAM_WQN_W)
# PTP configuration
export PARAM_PTP_TS_EN := 1
export PARAM_PTP_TS_FMT_TOD := 0
export PARAM_PTP_CLK_PER_NS_NUM := 512
export PARAM_PTP_CLK_PER_NS_DENOM := 165
export PARAM_PTP_CLK_PER_NS_DEN := 165
# PCIe interface configuration
export PARAM_AXIS_PCIE_DATA_W := 256

8
src/cndm/tb/cndm_micro_pcie_us/test_cndm_micro_pcie_us.py
View File

@@ -481,12 +481,18 @@ def test_cndm_micro_pcie_us(request, pcie_data_w, mac_data_w):
# Structural configuration
parameters['PORTS'] = 2
parameters['SYS_CLK_PER_NS_NUM'] = 4
parameters['SYS_CLK_PER_NS_DEN'] = 1
# Queue configuration
parameters['WQN_W'] = 5
parameters['CQN_W'] = parameters['WQN_W']
# PTP configuration
parameters['PTP_TS_EN'] = 1
parameters['PTP_TS_FMT_TOD'] = 0
parameters['PTP_CLK_PER_NS_NUM'] = 512
parameters['PTP_CLK_PER_NS_DENOM'] = 165
parameters['PTP_CLK_PER_NS_DEN'] = 165
# PCIe interface configuration
parameters['AXIS_PCIE_DATA_W'] = pcie_data_w

16
src/cndm/tb/cndm_micro_pcie_us/test_cndm_micro_pcie_us.sv
View File

@@ -34,12 +34,18 @@ module test_cndm_micro_pcie_us #
// Structural configuration
parameter PORTS = 2,
parameter SYS_CLK_PER_NS_NUM = 4,
parameter SYS_CLK_PER_NS_DEN = 1,
// Queue configuration
parameter WQN_W = 5,
parameter CQN_W = WQN_W,
// PTP configuration
parameter logic PTP_TS_EN = 1'b1,
parameter logic PTP_TS_FMT_TOD = 1'b0,
parameter PTP_CLK_PER_NS_NUM = 512,
parameter PTP_CLK_PER_NS_DENOM = 165,
parameter PTP_CLK_PER_NS_DEN = 165,
// PCIe interface configuration
parameter AXIS_PCIE_DATA_W = 256,
@@ -206,12 +212,18 @@ cndm_micro_pcie_us #(
// Structural configuration
.PORTS(PORTS),
.SYS_CLK_PER_NS_NUM(SYS_CLK_PER_NS_NUM),
.SYS_CLK_PER_NS_DEN(SYS_CLK_PER_NS_DEN),
// Queue configuration
.WQN_W(WQN_W),
.CQN_W(CQN_W),
// PTP configuration
.PTP_TS_EN(PTP_TS_EN),
.PTP_TS_FMT_TOD(PTP_TS_FMT_TOD),
.PTP_CLK_PER_NS_NUM(PTP_CLK_PER_NS_NUM),
.PTP_CLK_PER_NS_DENOM(PTP_CLK_PER_NS_DENOM),
.PTP_CLK_PER_NS_DEN(PTP_CLK_PER_NS_DEN),
// PCIe interface configuration
.RQ_SEQ_NUM_W(RQ_SEQ_NUM_W),