Rename byte_width to byte_lanes
This commit is contained in:
@@ -170,14 +170,14 @@ class XgmiiSource(Reset):
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self.queue_occupancy_limit_frames = -1
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self.width = len(self.data)
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self.byte_width = len(self.ctrl)
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self.byte_lanes = len(self.ctrl)
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assert self.width == self.byte_width * 8
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assert self.width == self.byte_lanes * 8
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self.idle_d = 0
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self.idle_c = 0
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for k in range(self.byte_width):
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for k in range(self.byte_lanes):
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self.idle_d |= XgmiiCtrl.IDLE << k*8
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self.idle_c |= 1 << k
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@@ -271,9 +271,9 @@ class XgmiiSource(Reset):
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await RisingEdge(self.clock)
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if self.enable is None or self.enable.value:
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if ifg_cnt + deficit_idle_cnt > self.byte_width-1 or (not self.enable_dic and ifg_cnt > 4):
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if ifg_cnt + deficit_idle_cnt > self.byte_lanes-1 or (not self.enable_dic and ifg_cnt > 4):
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# in IFG
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ifg_cnt = ifg_cnt - self.byte_width
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ifg_cnt = ifg_cnt - self.byte_lanes
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if ifg_cnt < 0:
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if self.enable_dic:
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deficit_idle_cnt = max(deficit_idle_cnt+ifg_cnt, 0)
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@@ -307,7 +307,7 @@ class XgmiiSource(Reset):
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else:
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min_ifg = 0
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if self.byte_width > 4 and (ifg_cnt > min_ifg or self.force_offset_start):
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if self.byte_lanes > 4 and (ifg_cnt > min_ifg or self.force_offset_start):
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ifg_cnt = ifg_cnt-4
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frame.start_lane = 4
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frame.data = bytearray([XgmiiCtrl.IDLE]*4)+frame.data
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@@ -327,7 +327,7 @@ class XgmiiSource(Reset):
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d_val = 0
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c_val = 0
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for k in range(self.byte_width):
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for k in range(self.byte_lanes):
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if frame is not None:
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d = frame.data[frame_offset]
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if frame.sim_time_sfd is None and d == EthPre.SFD:
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@@ -337,7 +337,7 @@ class XgmiiSource(Reset):
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frame_offset += 1
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if frame_offset >= len(frame.data):
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ifg_cnt = max(self.ifg - (self.byte_width-k), 0)
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ifg_cnt = max(self.ifg - (self.byte_lanes-k), 0)
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frame.sim_time_end = get_sim_time()
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frame.handle_tx_complete()
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frame = None
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@@ -380,9 +380,9 @@ class XgmiiSink(Reset):
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self.queue_occupancy_frames = 0
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||||
self.width = len(self.data)
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self.byte_width = len(self.ctrl)
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self.byte_lanes = len(self.ctrl)
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assert self.width == self.byte_width * 8
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assert self.width == self.byte_lanes * 8
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self._run_cr = None
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@@ -450,7 +450,7 @@ class XgmiiSink(Reset):
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await RisingEdge(self.clock)
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if self.enable is None or self.enable.value:
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for offset in range(self.byte_width):
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for offset in range(self.byte_lanes):
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d_val = (self.data.value.integer >> (offset*8)) & 0xff
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c_val = (self.ctrl.value.integer >> offset) & 1
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@@ -123,7 +123,7 @@ async def run_test_alignment(dut, payload_data=None, ifg=12, enable_dic=True,
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tb = TB(dut)
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byte_width = tb.source.width // 8
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byte_lanes = tb.source.byte_lanes
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tb.source.ifg = ifg
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tb.source.enable_dic = enable_dic
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@@ -164,23 +164,23 @@ async def run_test_alignment(dut, payload_data=None, ifg=12, enable_dic=True,
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for test_data in test_frames:
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if ifg == 0:
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lane = 0
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if force_offset_start and byte_width > 4:
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if force_offset_start and byte_lanes > 4:
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lane = 4
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start_lane_ref.append(lane)
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lane = (lane + len(test_data)+4+ifg) % byte_width
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lane = (lane + len(test_data)+4+ifg) % byte_lanes
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if enable_dic:
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offset = lane % 4
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if deficit_idle_count+offset >= 4:
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offset += 4
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lane = (lane - offset) % byte_width
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lane = (lane - offset) % byte_lanes
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deficit_idle_count = (deficit_idle_count + offset) % 4
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else:
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offset = lane % 4
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if offset > 0:
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offset += 4
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lane = (lane - offset) % byte_width
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lane = (lane - offset) % byte_lanes
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tb.log.info("start_lane_ref: %s", start_lane_ref)
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